已知Q3Q2Q1Q0是同步十进制计数器的触发器输出，若以Q3作进位，则其周期和脉冲宽度是（）。 -题库考试答案搜索网

已知Q3Q2Q1Q0是同步十进制计数器的触发器输出，若以Q3作进位，则其周期和脉冲宽度是（）。

单选题

2022-01-15 00:12

A、10个CP脉冲，正脉冲宽度为1个CP周期
B、10个CP脉冲，正脉冲宽度为2个CP周期
C、10个CP脉冲，正脉冲宽度为4个CP周期
D、10个CP脉冲，正脉冲宽度为8个CP周期

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正确答案

B

试题解析

标签：注册电气工程师（发输变电）公共基础

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构成模值为256的二进制计数器，需要（）级触发器。

在异步二进制计数器中，从0开始计数，当十进制数为60时，需要触发器的个数为（）个。

用二进制异步计数器从0做加法，计到十进制数178，则最少需要（）个触发器。

构成同步二进制计数器一般应选用的触发器是（）。

在同步计数器中，CP脉冲和所有触发器的状态变化（）。

同步RS触发器用作计数器时，会出现（）现象。

用二进制异步计数器从0做加法，计到十进制数178，则最少需要（）个触发器。

在异步二进制计数器中，从0开始计数，当十进制数为60时，需要触发器的个数为（　　）。

已知Q3Q2Q1Q0是同步十进制计数器的触发器输出，若以Q3作进位，则其周期和脉冲宽度是（）。

根据异步二进制加法计数器的触发规律，每输入（）个脉冲，第二位输出一个进位脉冲。

有八个触发器的二进制计数器，它们最多有（）种计数状态。

实现十进制数加法计数需用（）个触发器。

相关题目: 欲设计0,1,2,3,4,5,6,7这几个数的计数器,如果设计合理,采用同步二进制计数器,最少应使用( )级触发器。; 用二进制异步计数器从0做加法,计到十进制数178,则最少需要( )个触发器。; 因为同步计数器中所有触发器都用的是同一个CP,所以它比异步计数器电路要简单一些; 选用上升沿触发的触发器做的4位二进制同步加法计数器和选用下降沿触发的触发器做的4位二进制同步加法计数器的状态转换图; 选用上升沿触发的触发器做的4位二进制同步加法计数器和选用下降沿触发的触发器做的4位二进制同步加法计数器的时序图是不一样的; 设计—个1位十进制计数器至少需要多少个触发器?( ); 构成一个5进制计数器需要5个触发器。 ( ); 设计一个同步10进制计数器,需要触发器。( ); N个触发器可以构成最大计数长度(进制数)为的计数器。; 构成一个五进制的计数器至少需要（）个触发器; 用触发器设计一个11进制的计数器,至少需要触发器的个数是( ); 设计一个3进制计数器可用（）个触发器实现; N个触发器组成的计数器最多可以组成（）进制的计数器; 在异步二进制计数器中，从0开始计数，当十进制数为60时，需要触发器的个数为（）个。; 同步RS触发器用作计数器时，会出现（）现象。; 用触发器组成12进制数计数器，至少应用触发器的个数为（）个。; 构成一个5进制计数器需要5个触发器。; 构成一个7进制计数器需要3个触发器。; 用触发器设计一个同步十七进制计数器所需要的触发器数目是（）。; 设计一个3进制计数器可用2个触发器实现。

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