在进行数字电路的可测试性设计时，下面说法错误的是（）。 -题库考试答案搜索网

在进行数字电路的可测试性设计时，下面说法错误的是（）。

单选题

2021-12-24 01:20

A、A．设计上应避免“线或”逻辑
B、B．所有不同相位和频率的时钟都应来自单一主时钟
C、C．数字电路应设计成主要以异步逻辑电路为基础的电路
D、D．电路应初始化到一明确的状态，以便确定测试的方法

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正确答案

C

试题解析

标签：智能仪器电子与通信技术

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