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在计算机运行时,建立各寄存器之间的“数据通路”并完成取指令和执行指令全过程的部件是

单选题
2023-03-06 07:34
A、时序产生器
B、程序计数器
C、操作控制器
D、指令寄存器
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C

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CPU中,保存当前正在执行的指令的寄存器是(59)。表征指令执行结果的寄存器是(60)。
在ASSUME伪指令设定了段寄存器后,无需在程序段中用指令完成赋值的寄存器是()。
下列哪条指令执行完成后,可以影响程序的标志状态寄存器?
下列指令执行完成后,使寄存器r0的值没有发生变化的是哪些?
下列指令执行完成后,使寄存器r1的值发生变化的是哪些?
下列哪些指令执行完成后,可以影响程序的标志状态寄存器?
一条指令执行分三步,取指令、分析指令、执行指令。
计算机执行指令分为取指令、分析指令、执行指令三个步骤。
某16位计算机中,带符号整数用补码表示,数据Cache和指令Cache分离。下表给出了指令系统中部分指令格式,其中Rs和Rd表示寄存器,mem表示存储单元地址,(X)表示寄存器X或存储单元X的内容。  该计算机采用5段流水方式执行指令,各流水段分别是取指(IF)、译码/读寄存器(ID)、执行/计算有效地址(EX)、访问存储器(M)和结果写回寄存器(WB),流水线采用“按序发射,按序完成”方式,没有采用转发技术处理数据相关,并且同一个寄存器的读和写操作不能在同一个时钟周期内进行。请回答下列问题。  (1)若int型变量x的值为-513,存放在寄存器R1中,则执行指令“SHR R1”后,R1的内容是多少?(用十六进制表示)  (2)若某个时间段中,有连续的4条指令进入流水线,在其执行过程中没有发生任何阻塞,则执行这4条指令所需的时钟周期数为多少?  (3)若高级语言程序中某赋值语句为x=a+b,x、a和b均为int型变量,它们的存储单元地址分别表示为[x]、[a]和[b]。该语句对应的指令序列及其在指令流水线中的执行过程如下图所示。则这4条指令执行过程中,I3的ID段和I4的IF段被阻塞的原因各是什么?  (4)若高级语言程序中某赋值语句为x=2×x+a,x和a均为unsigned int类型变量,它们的存储单元地址分别表示为[x]、[a],则执行这条语句至少需要多少个时钟周期?要求模仿上图画出这条语句对应的指令序列及其在流水线中的执行过程示意图。
计算机的工作过程就是周而复始地获取指令和执行指令的过程。()
在计算机运行时,建立各寄存器之间的“数据通路”并完成取指令和执行指令全过程的部件是
某计算机有如下图所示的功能部件,其中M为主存,指令和数据均存放在其中,MDR为主存数据寄存器,MAR为主存地址寄存器,R 0 ~R 3 为通用寄存器,IR为指令寄存器,P√C为程序计数器(具有自动加1功能),C、D为暂存寄存器,ALU为算术逻辑单元,移位器可左移、右移、直通传送。 (1) 将所有功能部件连接起来,组成完整的数据通路,并用单向或双向箭头表示信息传送方向。 (2) 画出“ADD R1,(R2)”指令周期流程图。该指令的含义是将R 1 中的数与(R 2 )指示的主存单元中的数相加,相加的结果直通传送至R 1 中。
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下面指令执行后,改变R1寄存器内容的指令是()。
MCS-51的指令寄存器是对指令寄存器中的指令进行译码,将指令转变为执行此指令所需要的电信号。( )
①微指令分成()和()微指令两类,()微指令可以同时执行若干个微操作,所以执行指令的速度比()微指令快。②在实现微程序时,取下一条微指令和执行本条微指令一般是()进行的,而微指令之间()是执行的。③实现机器指令的微程序一般是存放在()中,而用户可写的控制存储器则由组成。
传统计算机在执行程序时,CPU总是相继地完成取指令和执行指令的动作,即,指令的----和执行是串行进行的
BIU负责取指令,EU负责指令的执行,它们之间既互相独立又------,使得8086可以在执行指令的同时进行取指令的操作
将第一条指令从内存取入CPU中译码执行,同时指令指针自动加1或按指令的要求作出相应改变,指向下一条要执行的指令,接着将下一条指令从内存取入-----执行,这样不断重复取指令和执行指令的过程,逐条执行指令,直至程序结束
内存用于存放计算机运行时的指令、程序、需处理的数据和运行结果。但是,存储在()中的内容是不能用指令修改的。
某计算机执行一条指令的过程分为取指令、分析指令和执行指令3段操作,每一段操作占用的时间分别是△t、2△t、3△t。若采用常规的顺序串行执行方式,连续执行n条指令所需时间是(7);若采用流水线方式,3段操作重叠执行时,连续执行n条指令所需时间是(8)。
●在下列不同结构的处理机上执行6×6的矩阵乘法C=A×B,计算所需要的最短时间。只计算乘法指令和加法指令的执行时间,不计算取操作数、数据传送和程序控制等指令的执行时间。加法部件和乘法部件的延迟时间都是3个时钟周期,另外,加法指令和乘法指令还要经过"取指令"和"指令译码"的时钟周期,每个时钟周期为20ns,C的初始值为"0"。各操作部件的输出端有直接数据通路连接到有关操作部件的输入端,在操作部件的输出端设置有足够容量的缓冲寄存器。如果处理机内只有一个通用操作部件,采用顺序方式执行指令,那么所需要的时间为 (5) 。如果单流水线标量处理机,有一条两个功能的静态流水线,流水线每个功能段的延迟时间均为一个时钟周期,加法操作和乘法操作各经过3个功能段,那么所需要的时间为 (6) 。105.6ms52.8ms39.6ms72.8ms(6)
在下列不同结构的处理机上执行6x6的矩阵乘法C:A×B,计算所需要的最短时间。只计算乘法指令和加法指令的执行时间,不计算取操作数、数据传送和程序控制等指令的执行时间。加法部件和乘法部件的延迟时间都是3个时钟周期,另外,加法指令和乘法指令还要经过“取指令”和“指令译码”的时钟周期,每个时钟周期为20ns,C的初始值为“0”。各操作部件的输出端有直接数据通路连接到有关操作部件的输入端,在操作部件的输出端设置有足够容量的缓冲寄存器。如果处理机内只有一个通用操作部件,采用顺序方式执行指令,那么所需要的时间为(5)。如果单流水线标量处理机,有一条两个功能的静态流水线,流水线每个功能段的延迟时间均为一个时钟周期,加法操作和乘法操作各经过3个功能段,那么所需要的时间为(6)。
在下列不同结构的处理机上执行6×6的矩阵乘法C=A×B,计算所需要的最短时间。只计算乘法指令和加法指令的执行时间,不计算取操作数、数据传送和程序控制等指令的执行时间。加法部件和乘法部件的延迟时间都是3个时钟周期,另外,加法指令和乘法指令还要经过“取指令”和“指令译码”的时钟周期,每个时钟周期为20ns,C的初始值为“0”。各操作部件的输出端有直接数据通路连接到有关操作部件的输入端,在操作部件的输出端设置有足够容量的缓冲寄存器。如果处理机内只有一个通用操作部件,采用顺序方式执行指令,那么所需要的时间为(25)。如果单流水线标量处理机,有一条两个功能的静态流水线,流水线每个功能段的延迟时间均为一个时钟周期,加法操作和乘法操作各经过3个功能段,那么所需要的时间为(26)。
在计算机硬件系统的基本组成中,完成解释指令、执行指令的功能是( )。
下面指令执行后,有可能改变AL寄存器内容的指令是()
在计算机体系结构中,CPU内部包括程序计数器PC、存储器数据寄存器MDR、指令寄存器IR和存储器地址寄存器MAR等。若CPU要执行的指令为:MOVR0,#100(即将数值100传送到寄存器R0中),则CPU首先要完成的操作是()。
试题(1)在计算机体系结构中,CPU内部包括程序计数器PC、存储器数据寄存器MDR、指令寄存器IR和存储器地址寄存器MAR等。若CPU要执行的指令为:MOV R0, #100(即将数值100传送到寄存器R0中),则CPU首先要完成的操作是 (1) 。(1)
●在计算机体系结构中,CPU内部包括程序计数器PC、存储器数据寄存器MDR、指令寄存器IR和存储器地址寄存器MAR等。若CPU要执行的指令为:MOVR0,#100(即将数值100传送到寄存器R0中),则CPU首先要完成的操作是(1)。 (1)
在计算机体系结构中,CPU内部包括程序计数器PC、存储器数据寄存器MDR、指令寄存器IR和存储器地址寄存器MAR等。若CPU要执行的指令为:MOV RO,#100(即将数值100传送到寄存器R0中),则CPU首先要完成的操作是(1)。
在计算机体系结构中,CPU内部包括程序计数器(PC)、存储器数据寄存器(MDR)、指令寄存器(IR)和存储器地址寄存器(MAR)等。若CPU要执行的指令为:MOV R1,#55(即将数值55传送到寄存器R1中),则CPU首先要完成的操作是(3)。
微型计算机中,用来执行程序指令,完成各种运算和控制功能的部件是()。
下面指令执行后,改变R1寄存器内容的指令是()
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